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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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4.1.7.1. Cyclone® V器件中的管脚映射
时钟 | 提供馈入 |
---|---|
inclk[0]和inclk[1] | 与 Cyclone® V 器件同侧的四个专用时钟管脚中的任何管脚。 |
inclk[2] |
|
inclk[3] | 时钟控制模块同一侧上的PLL的PLL计数器 C1和C3( Cyclone® V器件的顶端,底部和右侧)。 Cyclone® V器件左侧上的时钟控制块没有连接输入时钟端口。 |