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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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3.1. 功能特性
Cyclone® V精度可调DSP模块具有以下特性:
- 高性能,功率优化和完全寄存的乘法运算操作
- 9-bit,18-bit和27-bit字长度
- 两个18 x 19复数乘法
- 内置加法,减法和双 64-bit累加单元用于组合乘法结果
- 级联 19-bit 或 27-bit 以形成滤波应用程序的抽头延迟线(tap-delay line)
- 级联64-bit输出总线以在无外部支持下将输出结果从一个模块传播至下一个模块。
- 对称滤波器19-bit和27-bit模式中支持的硬核预加法器
- 用于滤波器实现的内部系数寄存器bank
- 具有分布式输出加法器的18-bit和27-bit脉动(Systolic )有限脉冲响应(FIR)滤波器
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