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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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6.4.3. DQS相移电路
如果DQS管脚用作FPGA的输入时钟或者选通,则 Cyclone® V DLL对读事务中的DQS管脚提供相移。
下图显示DLL如何连接各种 Cyclone® V器件系列的DQS管脚。每个DLL的参考时钟可能由相邻PLL提供。
注: 下图显示器件中所有可能的连接。有关每种器件封装中可用的管脚和连接有信息,请参考器件管脚说明(pin-out)文件。
图 120. Cyclone® V E (A2和A4)器件中的DQS管脚和DLL
图 121. Cyclone® V GX(C3)器件中的DQS管脚和DLL
图 122. Cyclone® V E (A5、A7和A9)、GX(C4、C5、C7和C9)、GT(D5、D7和D9)器件中的DQS管脚和DLL
图 123. Cyclone® V SE(A2、A4、A5和A6)器件中的DQS管脚和DLL
图 124. Cyclone® V SX(C2、C4、C5和C6)和ST(D5和D6)器件中的DQS管脚和DLL