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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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5.3.1. Cyclone® V器件中FPGA I/O的I/O标准支持
I/O 标准 | 标准支持 |
---|---|
3.3 V LVTTL/3.3 V LVCMOS | JESD8-B |
3.0 V LVTTL/3.0 V LVCMOS | JESD8-B |
3.0 V PCI 7 | PCI Rev. 2.2 |
3.0 V PCI-X 8 | PCI-X Rev. 1.0 |
2.5 V LVCMOS | JESD8-5 |
1.8 V LVCMOS | JESD8-7 |
1.5 V LVCMOS | JESD8-11 |
1.2 V LVCMOS | JESD8-12 |
SSTL-2 Class I | JESD8-9B |
SSTL-2 Class II | JESD8-9B |
SSTL-18 Class I | JESD8-15 |
SSTL-18 Class II | JESD8-15 |
SSTL-15 Class I | — |
SSTL-15 Class II | — |
1.8 V HSTL Class I | JESD8-6 |
1.8 V HSTL Class II | JESD8-6 |
1.5 V HSTL Class I | JESD8-6 |
1.5 V HSTL Class II | JESD8-6 |
1.2 V HSTL Class I | JESD8-16A |
1.2 V HSTL Class II | JESD8-16A |
Differential SSTL-2 Class I | JESD8-9B |
Differential SSTL-2 Class II | JESD8-9B |
Differential SSTL-18 Class I | JESD8-15 |
Differential SSTL-18 Class II | JESD8-15 |
Differential SSTL-15 Class I | — |
Differential SSTL-15 Class II | — |
Differential 1.8 V HSTL Class I | JESD8-6 |
Differential 1.8 V HSTL Class II | JESD8-6 |
Differential 1.5 V HSTL Class I | JESD8-6 |
Differential 1.5 V HSTL Class II | JESD8-6 |
Differential 1.2 V HSTL Class I | JESD8-16A |
Differential 1.2 V HSTL Class II | JESD8-16A |
LVDS | ANSI/TIA/EIA-644 |
RSDS9 | — |
Mini-LVDS 10 | — |
LVPECL | — |
SLVS | JESD8-13 |
Sub-LVDS | — |
HiSpi | — |
SSTL-15 | JESD79-3D |
SSTL-135 | — |
SSTL-125 | — |
HSUL-12 | — |
Differential SSTL-15 | JESD79-3D |
Differential SSTL-135 | — |
Differential SSTL-125 | — |
Differential HSUL-12 | — |
7 不支持3.3 V PCI I/O标准。
8 不支持3.3 V PCI-X I/O标准。PCI-X不符合先行区域的PCI-X I–V曲线要求。