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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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2.3. 嵌入式存储器特性
功能特性 | M10K | MLAB |
---|---|---|
最大工作频率 | 315 MHz |
420 MHz |
每块容量(包括奇偶校验位) | 10,240 |
640 |
奇偶校验位 | 支持 | 支持 |
字节使能 | 支持 | 支持 |
Packed模式 | 支持 | — |
地址时钟使能 | 支持 | 支持 |
简单双端口混合位宽 | 支持 | — |
真双端口混合位宽 | 支持 | — |
FIFO缓冲混合位宽 | 支持 | — |
存储器初始化文件(.mif) | 支持 | 支持 |
混合时钟模式 | 支持 | 支持 |
全同步存储器 | 支持 | 支持 |
异步存储器 | — | 仅支持直通(flow-through)读存储器操作。 |
上电状态 | 输出端口清零。 |
|
异步清零 | 输出寄存器和输出锁存器 | 输出寄存器和输出锁存器 |
读/写操作触发 | 时钟上升沿 | 时钟上升沿 |
相同端口read-during-write | 输出端口设为"new data"或"don't care"。 ("don't care"模式仅适用于单端口RAM模式)。 |
输出端口设为"don't care"。 |
混合端口read-during-write | 输出端口设为"old data"或"don't care"。 | 输出端口设为"old data","new data","don't care"或者"constrained don't care"。 |
ECC支持 | 使用 Intel® Quartus® Prime软件的Soft IP支持 |
使用 Intel® Quartus® Prime软件的Soft IP支持 |