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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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2.9. 存储器模块地址时钟使能支持
嵌入式存储器模块支持地址时钟使能,当信号使能时(addressstall = 1),该地址时钟使能会保持之前的地址值。在双端口模式下配置存储器模块时,每个端口都有各自独立的地址时钟使能。地址时钟使能信号的默认值为低电平(已禁用)。
图 16. 地址时钟使能下图显示地址时钟使能结构图。参阅端口名addressstall了解地址时钟使能。
图 17. 读周期中的地址时钟使能波形下图显示了读周期中的地址时钟使能波形。
图 18. 写周期中的地址时钟使能波形下图显示了写周期中地址时钟使能波形。