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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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6.1. 外部存储器性能
接口 | 电压 (V) | 最大频率 (MHz) | 最小频率 (MHz) | |
---|---|---|---|---|
硬核控制器 | 软核控制器 | |||
DDR3 SDRAM | 1.5 | 400 | 303 | 303 |
1.35 | 400 | 303 | 303 | |
DDR2 SDRAM | 1.8 | 400 | 300 | 167 |
LPDDR2 SDRAM | 1.2 | 333 | 300 | 167 |