仅对英特尔可见 — GUID: nik1398706818885
Ixiasoft
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2.4.7. 动态重配置参数
每个收发器通道和PLL均包括一个Avalon存储器映射接口从接口用于重配置。此接口提供对每个通道和PLL的可编程地址空间的直接访问。由于每个通道和PLL均包含一个专用的Avalon存储器映射接口从接口,因此可以同时或逐一动态修改通道。如果您的系统不需要同时重配置,那么您可以参数化Transceiver Native PHY IP以共享同一个重配置接口。
您可以使用动态重配置来更改收发器通道和PLL的众多功能和特性。例如,您可以将参考时钟输入更改成TX PLL。您也可以在Standard和Enhanced数据通路之间进行更改。
若要使能Native PHY IP core中的英特尔Arria 10收发器工具包功能,则必须使能以下选项:
- Enable dynamic reconfiguration
- Enable Native PHY Debug Master Endpoint
- Enable capability registers
- Enable control and status registers
- Enable PRBS (Pseudo Random Binary Sequence) soft accumulators
参数 | 值 | 说明 |
---|---|---|
Enable dynamic reconfiguration | On/Off | 开启此选项时,使能动态重配置接口。 |
Share reconfiguration interface | On/Off | 开启此选项时,Transceiver Native PHY IP提供一个Avalon存储器映射接口从接口,用于对所有通道的动态重配置。在这种配置中,重配置地址总线的[n-1:10]高地址比特指定通道。通道编号是二进制编码的。地址比特[9:0]提供了一个通道的重配置空间内的寄存器偏移地址。 |
Enable Native PHY Debug Master Endpoint | On/Off | 开启此选项时,Transceiver Native PHY IP包括一个嵌入的Native PHY Debug Master Endpoint (NPDME),从内部连接到Avalon存储器映射接口从接口进行动态重配置。NPDME能够访问收发器的重配置空间。它能够使用System Console通过JTAG执行某些测试和调试功能。对于使用多个通道的配置就,此选项要求您使能Share reconfiguration interface选项。 |
Separate reconfig_waitrequest from the status of AVMM arbitration with PreSICE | On/Off | 使能时,reconfig_waitrequest不通过PreSICE显示Avalon存储器映射接口仲裁的状态。Avalon存储器映射接口仲裁的状态是通过一个软核状态寄存器比特反映出来的。此特性要求使能"Optional Reconfiguration Logic"下的"Enable control and status registers"功能。 |
参数 | 值 | 说明 |
---|---|---|
Enable capability registers | On/Off | 使能功能(capability)寄存器,该寄存器提供关于收发器通道配置的高级信息。 |
Set user-defined IP identifier | User-defined | 设置一个用户定义的数字标识符,当功能(capability)寄存器使能时,可以从user_identifier偏移读取该标识符。 |
Enable control and status registers | On/Off | 使能软核寄存器,通过嵌入式调试读取PHY接口上的状态信号和写入控制信号。 |
Enable PRBS (Pseudo Random Binary Sequence) soft accumulators | On/Off | 使能软核逻辑,当使用硬核PRBS生成器和检查器时执行PRBS比特和错误累加。 |
参数 | 值 | 说明 |
---|---|---|
Configuration file prefix | <prefix> | 这里指定所生成配置文件的前缀。每种类型的Transceiver Native PHY IP都应该对配置文件使用唯一的前缀。 |
Generate SystemVerilog package file | On/Off | 开启此选项时,Transceiver Native PHY IP生成一个SystemVerilog封装文件reconfig_parameters.sv,包含使用重配置所需的属性值定义的参数。 |
Generate C header file | On/Off | 开启此选项时,Transceiver Native PHY IP生成一个C头文件(C header file),reconfig_parameters.h,包含使用重配置所需的属性值定义的宏。 |
Generate MIF (Memory Initialization File) | On/Off | 开启此选项时,Transceiver Native PHY IP生成一个MIF,reconfig_parameters.mif,包含重配置所需要的数据格式的属性值。 |
Include PMA analog settings in configuration files | On/Off | 使能时,IP允许您对在Analog PMA settings (Optional)选项卡中选择的PMA模拟设置进行配置。这些设置将包含在生成的配置文件中。
注: 您仍然必须使用Quartus中的Quartus Prime Setting File (.qsf) assignment来对当前配置指定模拟设置。此选项不会去除对模拟设置指定Quartus Prime Setting File (.qsf) assignment的要求。关于使用QSF assignment的详细信息,请参考 Arria® 10 收发器PHY用户指南中的模拟参数设置章节。
|
参数 | 值 | 说明 |
---|---|---|
Enable multiple reconfiguration profiles | On/Off | 使能后,您可以使用GUI来存储多个配置。Quartus使用此信息在时序驱动编译期间包括所有配置的必要时序电弧。Native PHY为所有存储的配置文件生成重配置文件。Native PHY还会检查多个重配置文件的一致性,以确保能够在它们之间进行重配置。除此之外,这还会检查是否已经对每种配置显示了相同的端口。28 |
Enable embedded reconfiguration streamer | On/Off | 使能嵌入式重配置streamer,从而自动执行多个预定义配置文件(profile)间动态重配置程序。这是可选的,可提高逻辑使用率。PHY包括在预配置文件之间进行动态重配置所需的所有逻辑和数据。 |
Generate reduced reconfiguration files | On/Off | 使能后,Native PHY会生成重配置报告文件,其中仅包含多个已配置配置文件之间不同的属性或RAM数据。通过使用减小的.mif文件,重配置时间也会缩短。 |
Number of reconfiguration profiles | 1-8 | 指定多个重配置文件(profile)被使能时可支持的重配置文件(profile)的数量。 |
Selected reconfiguration profile | 0-7 | 选择在单击所选配置文件(profile)的相关按钮时要存储/加载/清除/刷新的重配置文件(reconfiguration profile)。 |
Store configuration to selected profile | - | 点击此按钮将当前的Native PHY参数设置保存或存储到由Selected reconfiguration profile参数指定的配置文件(profile)中。 |
Load configuration from selected profile | - | 点击此按钮从Selected reconfiguration profile参数指定的已存储配置文件(profile)中加载当前的Native PHY和参数设置。 |
Clear selected profile | - | 点击此按钮将清除或删除由Selected reconfiguration profile参数指定的配置文件(profile)的存储Native PHY参数设置。一个空的配置文件(profile)将默认为Native PHY的当前参数设置。 |
Clear all profiles | - | 单击此按钮将清除所有配置文件(profile)的Native PHY参数设置。 |
Refresh selected profile | - | 点击此按钮相当于按顺序单击Load configuration from selected profile和Store configuration to selected profile按钮。此操作从Selected reconfiguration profile参数指定的已存储的配置文件(profile)中加载Native PHY参数设置,然后将该参数保存回到配置文件。 |
参数 | 值 | 说明 |
---|---|---|
TX Analog PMA Settings | ||
Analog Mode (Load 英特尔-recommended Default settings) | Cei_11100_lr to xfp_9950 | 选择模拟协议模式来预选TX管脚摆幅设置(VOD,Pre-emphasis和Slew Rate)。在GUI加载预选值后,如果需要修改独立的TX管脚摆幅设置中的一个或多个,那么要使能此选项来覆盖英特尔建议的默认值以单独地修改设置。 |
Override 英特尔-recommended Analog Mode Default settings | On/Off | 使能此选项以对一个或多个TX模拟参数的所选的TX模拟模式覆盖英特尔建议的设置。 |
Output Swing Level (VOD) | 0-31 | 选择发送器可编程的输出差分电压摆幅。 |
Pre-Emphasis First Pre-Tap Polarity | Fir_pre_1t_neg Fir_pre_1t_pos |
选择预加重的第一个预抽头的极性。 |
Pre-Emphasis First Pre-Tap Magnitude | 0-16 29 | 选择预加重的第一个预抽头(pre-tap)的幅度。 |
Pre-Emphasis Second Pre-Tap Polarity | Fir_pre_2t_neg Fir_pre_2t_pos |
选择预加重的第二个预抽头(pre-tap)的极性。 |
Pre-Emphasis Second Pre-Tap Magnitude | 0-7 30 | 选择预加重的第二个预抽头(pre-tap)的幅度。 |
Pre-Emphasis First Post-Tap Polarity | Fir_post_1t_neg Fir_post_1t_pos |
选择预加重的第一个后抽头(post-tap)的极性。 |
Pre-Emphasis First Post-Tap Magnitude | 0-25 31 | 选择预加重的第一个后抽头(post-tap)的幅度。 |
Pre-Emphasis Second Post-Tap Polarity | Fir_post_2t_neg Fir_post_2t_pos |
选择预加重的第二个后抽头(post-tap)的极性。 |
Pre-Emphasis Second Post-Tap Magnitude | 0-12 32 | 选择预加重的第二个后抽头(post-tap)的幅度。 |
Slew Rate Control | slew_r0 to slew_r5 | 选择TX输出信号的摆率。有效值包括从最慢至最快的速率。 |
High-Speed Compensation | Enable/Disable | 使能TX驱动器中的配电网络(PDN)导致的符号间干扰(ISI)补偿。使能时,它会减少由PDN导致的ISI抖动,但会增加功耗。 |
On-Chip termination | r_r1 r_r2 |
选择片上TX差分终端。 |
RX Analog PMA settings | ||
Override 英特尔-recommended Default settings | On/Off | 使能此选项来覆盖一个或多个RX模拟参数的英特尔建议的设置。 |
CTLE (Continuous Time Linear Equalizer) mode | non_s1_mode S1_mode |
对Continuous Time Linear Equalizer (CTLE)选择RX高增益模式non_s1_mode或者RX高数据速率模式s1_mode。 |
DC gain control of high gain mode CTLE | No_dc_gain to stg4_gain7 | 选择高增益(high gain)模式下的Continuous Time Linear Equalizer (CTLE)的DC增益 |
AC Gain Control of High Gain Mode CTLE | radp_ctle_acgain_4s_0 to radp_ctle_acgain_4s_28 | 选择高增益模式下的Continuous Time Linear Equalizer (CTLE)(手动模式)的AC增益。 |
AC Gain Control of High Data Rate Mode CTLE | radp_ctle_eqz_1s_sel_0 to Radp_ctle_eqz_1s_sel_15 | 选择在高增益模式下Continuous Time Linear Equalizer (CTLE)(当CTLE处于手动模式时)的AC增益。 |
Variable Gain Amplifier (VGA) Voltage Swing Select | radp_vga_sel_0 to radp_vga_sel_7 | 选择CTLE以及DFE模块都处于手动模式时的Variable Gain Amplifier (VGA)输出电压摆幅。 |
Decision Feedback Equalizer (DFE) Fixed Tap 1 Co-efficient | radp_dfe_fxtap1_0 to radp_dfe_fxtap1_127 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头1的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 2 Co-efficient | radp_dfe_fxtap2_0 to radp_dfe_fxtap2_127 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头2的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 3 Co-efficient | radp_dfe_fxtap3_0 to radp_dfe_fxtap3_127 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头3的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 4 Co-efficient | radp_dfe_fxtap4_0 to radp_dfe_fxtap4_63 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头4的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 5 Co-efficient | radp_dfe_fxtap5_0 to radp_dfe_fxtap5_63 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头5的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 6 Co-efficient | radp_dfe_fxtap6_0 to radp_dfe_fxtap6_31 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头6的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 7 Co-efficient | radp_dfe_fxtap7_0 to radp_dfe_fxtap7_31 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头7的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 8 Co-efficient | radp_dfe_fxtap8_0 to radp_dfe_fxtap8_31 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头8的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 9 Co-efficient | radp_dfe_fxtap9_0 to radp_dfe_fxtap9_31 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头9的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 10 Co-efficient | radp_dfe_fxtap10_0 to radp_dfe_fxtap10_31 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头10的系数。 |
Decision Feedback Equalizer (DFE) Fixed Tap 11 Co-efficient | radp_dfe_fxtap11_0 to radp_dfe_fxtap11_31 | 选择Decision Feedback Equalizer (DFE)在手动模式下运行时的固定抽头11的系数。 |
On-Chip termination | R_ext0, r_r1, r_r2 | 选择片上RX差分终端。 |
参数 | 值 | 说明 |
---|---|---|
Generate parameter documentation file | On/Off | 当开启此选项时,生成一个Comma-Separated Value (.csv)文件,其中包括Transceiver Native PHY IP参数的描述。 |