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4.1. Intel® Agilex™ 高速SERDES I/O概述
4.2. 使用LVDS SERDES Intel FPGA IP实现高速LVDS I/O
4.3. Intel® Agilex™ LVDS SERDES发送器
4.4. Intel® Agilex™ LVDS SERDES接收器
4.5. LVDS SERDES IP初始化和复位
4.6. External PLL模式的 Intel® Agilex™ LVDS接口
4.7. Intel® Agilex™ LVDS SERDES源同步时序预算
4.8. LVDS SERDES IP时序
4.9. LVDS SERDES IP设计实例
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3.1.1. 单端I/O标准OCT匹配
串行(RS)和并行(RT) OCT提供了I/O阻抗匹配和匹配性能。OCT维持信号质量,节省电路板空间,并降低外部组件成本。
OCT校准电路使用外部电阻的阻抗,外部电阻与RZQ管脚连接作为参考。I/O缓冲器的阻抗不断变化,直到在OCT校准期间达到目标阻抗为止。当I/O缓冲器的阻抗达到参考电阻的预定比率时,达到目标阻抗。
方向 | OCT方案 |
---|---|
输出 | 带校准的RS OCT |
不带校准的RS OCT | |
输入 | 带校准的RT OCT |
双向 | 动态RS OCT和RT OCT |