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4.1. Intel® Agilex™ 高速SERDES I/O概述
4.2. 使用LVDS SERDES Intel FPGA IP实现高速LVDS I/O
4.3. Intel® Agilex™ LVDS SERDES发送器
4.4. Intel® Agilex™ LVDS SERDES接收器
4.5. LVDS SERDES IP初始化和复位
4.6. External PLL模式的 Intel® Agilex™ LVDS接口
4.7. Intel® Agilex™ LVDS SERDES源同步时序预算
4.8. LVDS SERDES IP时序
4.9. LVDS SERDES IP设计实例
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8. Intel® Agilex™ 通用I/O和LVDS SERDES用户指南的文档修订历史
文档版本 | Intel® Quartus® Prime版本 | 修订内容 |
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2019.12.16 | 19.4 |
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2019.09.30 | 19.3 |
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2019.04.02 | 19.1 | 首次发布。 |