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4.1. Intel® Agilex™ 高速SERDES I/O概述
4.2. 使用LVDS SERDES Intel FPGA IP实现高速LVDS I/O
4.3. Intel® Agilex™ LVDS SERDES发送器
4.4. Intel® Agilex™ LVDS SERDES接收器
4.5. LVDS SERDES IP初始化和复位
4.6. External PLL模式的 Intel® Agilex™ LVDS接口
4.7. Intel® Agilex™ LVDS SERDES源同步时序预算
4.8. LVDS SERDES IP时序
4.9. LVDS SERDES IP设计实例
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1.1. Intel® Agilex™ I/O和差分I/O缓存
GPIO接口中的I/O bank支持差分和单端I/O标准。GPIO bank具有使用True Differential Signaling I/O标准的真差分I/O缓存,True Differential Signaling I/O标准兼容于LVDS,RSDS,Mini-LVDS和LVPECL I/O标准。真差分缓存形成一对单向真差分通道。真差分通道的一半支持专用发送器管脚,另一半支持专用真接收器管脚。关于专用接收器和发送器通道的位置,请参考器件管脚(device pin-out)文件。
差分电压参考的输出管脚不是真差分输出管脚。差分电压参考的I/O标准使用两个单端输出管脚,其中一个输出管脚是反相的。
HPS和SDM接口中的I/O bank支持单端IO标准。
Intel® Agilex™ 器件使用不同的电源对不同接口的I/O缓存供电:
- VCCIO_PIO和VCCPT对GPIO接口中位于I/O bank中的I/O缓存供电。
- VCCIO_SDM对SDM I/O接口中位于I/O bank中的I/O缓存供电。
- VCCIO_HPS对HPS I/O接口中位于HPS I/O bank中的I/O缓存供电。
接口中的每个I/O bank都其各自的VCCIO电源,仅支持一个VCCIO电压。接口之间的支持I/O标准各不相同。请参考所支持的I/O标准来了解每个I/O接口所支持的I/O标准列表。