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每个精度可调DSP模块有两个脉动寄存器。如果精度可调DSP模块没有配置成定点运算脉动FIR模式,那么这两个脉动寄存器都被旁路。
第一组脉动寄存器包括18-bit和19-bit寄存器,分别用于寄存顶部乘法器的18-bit和19-bit输入。
第二组脉动寄存器用于延迟前一个精度可调DSP模块的chainin输入。
您必须使用与输出寄存器块相同的时钟源对所有的脉动寄存器提供时钟。必须开启输出寄存器。