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5.6.4. Arria® 10 器件中的差分接收器
此接收器具有一个差分缓冲和I/O PLL,可在发送器与接收器之间共享、一个DPA模块、一个同步器、一个数据重对齐模块和一个解串器。差分缓冲器可接收LVDS、mini-LVDS和RSDS信号电平。您可以在 Quartus® Prime软件的Assignment Editor中静态地将接收器管脚的I/O标准设置成LVDS、SLVS、mini-LVDS或者RSDS。
注: 要驱动LVDS通道,必须使用整数分频PLL模式中的PLL。
专用电路/特性 | 说明 |
---|---|
差分I/O 缓冲器 | 支持LVDS、mini-LVDS和RSDS |
SERDES | 高达10位宽的解串器 |
锁相环(PLL) | 生成不同相位的时钟用于数据同步器 |
数据重新对齐(Bit slip) | 位延迟插入到串行数据 |
DPA | 选择最接近串行数据相位的相位 |
同步器(FIFO缓冲器) | 对数据与接收器的输入参考时钟之间的相位差异进行补偿 |
偏移调整 | 手动 |
片上匹配(OCT) | 在LVDS I/O标准中100 Ω |