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6.7.1.2. 延迟锁相环
延迟锁相环(DLL)查找9位延迟链的延迟设置,这样,该延迟链等于1个时钟周期。
每个I/O bank含有1个延迟锁相环(DLL),位于中央,它支持800 MHz至1.3 GHz的频率范围。
DLL的参考时钟来自同一I/O bank的PLL输出。该DLL将参考时钟划分为八,并创建两个时钟脉冲 — launch和measure。launch和measure之间的相位差是1个参考时钟周期。时钟脉冲launch通过延迟链控制的延迟设置来布线。延迟后的launch之后与measure进行比较。
DLL延迟链的设置来自9位的计数器,它向上或向下移动来改变延迟时间,直到延迟后的launch和measure对齐到同一相位。一旦DLL被锁定,通过延迟链的延迟等于1个参考时钟周期,而延迟设置被发送到DQS延迟模块。