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双倍累加寄存器是累加器反馈路径中的一个额外寄存器。使能双倍累加寄存器将导致累加器反馈路径中的一个额外时钟周期。
此寄存器具有与输出寄存器块相同的CLK,ENA和ACLR设置。
通过使能此寄存器能够有两个使用相同数量精度可调DSP模块的累加器通道。这在处理交错复杂数据(I, Q)时很有用。