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1.1. 部分重配置术语
1.2. 部分重配置过程序列
1.3. 内部主机部分重配置
1.4. 外部主机部分重配置
1.5. 部分重配置设计考量
1.6. 部分重配置设计流程
1.7. 层次化部分重配置(Hierarchical Partial Reconfiguration)
1.8. 部分重配置设计时序分析
1.9. 部分重配置设计仿真
1.10. 部分重配置设计调试
1.11. PR比特流安全性验证( Intel® Stratix® 10和 Intel® Agilex™ 设计)
1.12. PR比特流压缩和加密( Intel® Arria® 10和 Intel® Cyclone® 10 GX设计)
1.13. 避免PR编程错误
1.14. 对PR设计导出与版本兼容的编译数据库
1.15. 创建一个部分重配置设计修订历史
2.1. 内部和外部PR主机配置
2.2. Partial Reconfiguration Controller Intel® FPGA IP
2.3. Partial Reconfiguration Controller Intel® Arria® 10 /Cyclone 10 FPGA IP
2.4. Partial Reconfiguration External Configuration Controller Intel® FPGA IP
2.5. Partial Reconfiguration Region Controller Intel® FPGA IP
2.6. Avalon-MM Partial Reconfiguration Freeze Bridge Intel® FPGA IP
2.7. Avalon-ST Partial Reconfiguration Freeze Bridge Intel® FPGA IP
2.8. 生成和仿真 Intel® FPGA IP
2.9. Intel® Quartus® Prime Pro Edition用户指南:部分重配置存档
2.10. 部分重配置解决方案IP用户指南修订历史
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1.7. 层次化部分重配置(Hierarchical Partial Reconfiguration)
层次化部分重配置(HPR)是部分重配置(PR)的扩展,其中一个PR区域包含在另一个PR区域内。您可以对子分区和父分区创建多个角色。子分区嵌套在其父分区中。重配置父分区不会影响静态区域中的操作,但是会将父区域的子分区替换为默认的子分区角色。
HPR设计流程包括以下步骤:
- 创建设计的基本修订版并导出静态区域,如步骤7:编译基本修订版和导出静态区域所述。
- 为每个角色创建实现修订版,如步骤8:设置PR实现修订版所述,导出父分区。
- 为静态区域和父区域指定.qdb文件分区。
- 指定父项或子项的对应实体。
注: 层次化PR (HPR)设计不支持PR比特流安全性验证。