仅对英特尔可见 — GUID: cfp1480557430715
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1.3.7. PCIe Gen1/Gen2/Gen3 Hard IP模块
PCIe Hard IP是一个IP模块,为PCI Express提供多层协议栈。用于 PCIe的 Intel® Stratix® 10 Hard IP是一个完整的PCIe解决方案,包括Transaction,Data Link和PHY/MAC层。Hard IP解决方案包括与收发器PHY接口连接的专用的硬核逻辑。每个收发器tile包含一个PCIe Hard IP模块,支持x1,x2,x4,x8和x16配置的PCIe Gen1,Gen2或者Gen3协议。x1,x2和x4配置会导致不可使用的通道。Hard IP位于tile的底部,16个通道高。此外,模块包括可扩展的VF (Virtual Functions)接口, 通过SRIOV-w (Single-Root I/O Virtualization)桥接实现高达2K VF。下表和图形显示了可能的PCIe Hard IP通道配置,不可用的通道数以及可用于其他协议的通道数。
PCIe Hard IP配置 | 不可使用的通道数量 | 可用于其他协议的通道数量 |
---|---|---|
PCIe x1 | 7 | 16 (4 for Intel® Stratix® 10 GX 10M devices) |
PCIe x2 | 6 | 16 (4 for Intel® Stratix® 10 GX 10M devices) |
PCIe x4 | 4 | 16 (4 for Intel® Stratix® 10 GX 10M devices) |
PCIe x8 | 0 | 16 (4 for Intel® Stratix® 10 GX 10M devices) |
PCIe x16 | 0 | 8 |
下表将所有收发器通道映射到可用tile中的PCIe Hard IP通道。
Tile通道序列 | PCIe Hard IP通道 | I/O Bank中的索引 | 左下Tile Bank编号 | 左上Tile Bank编号 | 右下Tile Bank编号 | 右上Tile Bank编号 |
---|---|---|---|---|---|---|
23 | — | 5 | 1F | 1N | 4F | 4N |
22 | — | 4 | 1F | 1N | 4F | 4N |
21 | — | 3 | 1F | 1N | 4F | 4N |
20 | — | 2 | 1F | 1N | 4F | 4N |
19 | — | 1 | 1F | 1N | 4F | 4N |
18 | — | 0 | 1F | 1N | 4F | 4N |
17 | — | 5 | 1E | 1M | 4E | 4M |
16 | — | 4 | 1E | 1M | 4E | 4M |
15 | 15 | 3 | 1E | 1M | 4E | 4M |
14 | 14 | 2 | 1E | 1M | 4E | 4M |
13 | 13 | 1 | 1E | 1M | 4E | 4M |
12 | 12 | 0 | 1E | 1M | 4E | 4M |
11 | 11 | 5 | 1D | 1L | 4D | 4L |
10 | 10 | 4 | 1D | 1L | 4D | 4L |
9 | 9 | 3 | 1D | 1L | 4D | 4L |
8 | 8 | 2 | 1D | 1L | 4D | 4L |
7 | 7 | 1 | 1D | 1L | 4D | 4L |
6 | 6 | 0 | 1D | 1L | 4D | 4L |
5 | 5 | 5 | 1C | 1K | 4C | 4K |
4 | 4 | 4 | 1C | 1K | 4C | 4K |
3 | 3 | 3 | 1C | 1K | 4C | 4K |
2 | 2 | 2 | 1C | 1K | 4C | 4K |
1 | 1 | 1 | 1C | 1K | 4C | 4K |
0 | 0 | 0 | 1C | 1K | 4C | 4K |
PCIe Hard IP模块包括可扩展的VF (Virtual Functions)接口, 通过SRIOV-2 (Single-Root I/O Virtualization)桥接实现高达2K VF。
在网络虚拟化中,单根输入/输出虚拟化或SR-IOV是一种网络接口,出于可管理性和性能原因,此网络接口支持PCI Express资源的隔离。使用SR-IOV规范在虚拟环境中共享一个物理PCI Express。SR-IOV规范对物理服务器上的不同的虚拟组件(例如:网络适配器)提供不同的虚拟功能。