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1. Intel® Cyclone® 10 GX器件中的逻辑阵列模块与自适应逻辑模块
2. Intel® Cyclone® 10 GX器件中的嵌入式存储器模块
3. Intel® Cyclone® 10 GX器件中的精度可调DSP模块
4. Intel® Cyclone® 10 GX器件中的时钟网络和PLL
5. Intel® Cyclone® 10 GX 器件的I/O和高速I/O
6. Intel® Cyclone® 10 GX 器件的外部存储器接口
7. Intel® Cyclone® 10 GX器件中的配置,设计安全和远程系统更新
8. Intel® Cyclone® 10 GX器件的SEU缓解
9. Intel® Cyclone® 10 GX器件中的JTAG边界扫描测试
10. Intel® Cyclone® 10 GX器件中的电源管理
5.1. Intel® Cyclone® 10 GX 器件中的I/O和差分I/O缓冲
5.2. Intel® Cyclone® 10 GX器件中的I/O标准和电压电平
5.3. Intel® Cyclone® 10 GX 器件的Intel FPGA I/O IP内核
5.4. Intel® Cyclone® 10 GX 器件的I/O资源
5.5. Intel® Cyclone® 10 GX 器件的体系结构和I/O的一般功能
5.6. Intel® Cyclone® 10 GX 器件的高速源同步SERDES和DPA
5.7. 在 Intel® Cyclone® 10 GX 器件中使用I/O和高速I/O
5.8. Intel® Cyclone® 10 GX器件的I/O和高速I/O的修订历史
6.1. Intel® Cyclone® 10 GX 外部存储器接口关键功能特性的解决方案
6.2. Intel® Cyclone® 10 GX器件支持的存储器标准
6.3. Intel® Cyclone® 10 GX 器件中的外部存储器接口宽度
6.4. Intel® Cyclone® 10 GX 器件中的外部存储器接口I/O管脚
6.5. Intel® Cyclone® 10 GX 器件封装中支持的存储器接口
6.6. Intel® Cyclone® 10 GX 器件中的外部存储器接口IP支持
6.7. Intel® Cyclone® 10 GX 器件的外部存储器接口体系结构
6.8. Intel® Cyclone® 10 GX器件中的外部存储器接口修订历史
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4.1.4.1. 专用时钟输入管脚
专用时钟输入管脚的来源如下:
- fPLL—HSSI列中的 REFCLK_GXB[L][1][C,D]_CH[B,T][p,n]
- I/O PLL—I/O列中的 CLK_[2A, 2J, 2K, 2L, 3A, 3B]_[0,1][p,n]
您可以将专用时钟输入管脚用于高扇出控制信号,例如:异步清零、预置和时钟使能信号,以及一些需要直接使用GCLK或者RCLK的协议信号。
专用时钟输入管脚可以是I/O PLL的差分时钟或者单端时钟。当专用时钟输入管脚用作单端时钟输入时,只有 CLK_[2,3][A..L]_[0,1][p,n] 管脚具有到PLL的专用连接。fPLL仅支持差分时钟输入。
通过全局或局域时钟驱动PLL能导致PLL输入上的更高抖动,并且PLL将无法对全局或局域时钟进行完全补偿。Intel建议使用专用时钟输入管脚来实现驱动PLL的最佳性能。