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1. Intel® Cyclone® 10 GX器件中的逻辑阵列模块与自适应逻辑模块
2. Intel® Cyclone® 10 GX器件中的嵌入式存储器模块
3. Intel® Cyclone® 10 GX器件中的精度可调DSP模块
4. Intel® Cyclone® 10 GX器件中的时钟网络和PLL
5. Intel® Cyclone® 10 GX 器件的I/O和高速I/O
6. Intel® Cyclone® 10 GX 器件的外部存储器接口
7. Intel® Cyclone® 10 GX器件中的配置,设计安全和远程系统更新
8. Intel® Cyclone® 10 GX器件的SEU缓解
9. Intel® Cyclone® 10 GX器件中的JTAG边界扫描测试
10. Intel® Cyclone® 10 GX器件中的电源管理
5.1. Intel® Cyclone® 10 GX 器件中的I/O和差分I/O缓冲
5.2. Intel® Cyclone® 10 GX器件中的I/O标准和电压电平
5.3. Intel® Cyclone® 10 GX 器件的Intel FPGA I/O IP内核
5.4. Intel® Cyclone® 10 GX 器件的I/O资源
5.5. Intel® Cyclone® 10 GX 器件的体系结构和I/O的一般功能
5.6. Intel® Cyclone® 10 GX 器件的高速源同步SERDES和DPA
5.7. 在 Intel® Cyclone® 10 GX 器件中使用I/O和高速I/O
5.8. Intel® Cyclone® 10 GX器件的I/O和高速I/O的修订历史
6.1. Intel® Cyclone® 10 GX 外部存储器接口关键功能特性的解决方案
6.2. Intel® Cyclone® 10 GX器件支持的存储器标准
6.3. Intel® Cyclone® 10 GX 器件中的外部存储器接口宽度
6.4. Intel® Cyclone® 10 GX 器件中的外部存储器接口I/O管脚
6.5. Intel® Cyclone® 10 GX 器件封装中支持的存储器接口
6.6. Intel® Cyclone® 10 GX 器件中的外部存储器接口IP支持
6.7. Intel® Cyclone® 10 GX 器件的外部存储器接口体系结构
6.8. Intel® Cyclone® 10 GX器件中的外部存储器接口修订历史
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9.5. IEEE Std. 1149.1边界扫描测试指南
使用IEEE Std. 1149.1器件运行BST时,请参考以下指导:
- SHIFT_IR 状态的第一个时钟周期内,如果“10...”码型未通过TDO管脚移出指令寄存器,则TAP控制器无法达到正确状态。可尝试下列方法解决这个问题:
- 验证TAP控制器已经正确达到 SHIFT_IR 状态。为促进TAP控制器达到 SHIFT_IR 状态,请返回RESET状态并将 01100 代码发送至TMS管脚。
- 查看与VCC、GND、JTAG以及器件上专用配置管脚的连接。
- 在首个EXTEST测试周期之前,运行一个 SAMPLE/PRELOAD 测试周期,以确保进入 EXTEST模式时,已知数据在器件管脚出现。如果OEJ更新寄存器包含0,那么OUTJ更新寄存器中的数据被驱动。必须确保该状态明确且正确,以避免与系统中的其它器件争用。
- 在in-circuit重配置期间不要运行EXTEST测试,因为in-circuit重配置期间不支持EXTEST。要运行测试,请等待配置完成或发布 CONFIG_IO 指令中断配置。
- 配置完成后,不可测试差分管脚对中的任何管脚。要在配置后运行BST,就需要编辑和重新定义与这些管脚对相对应的BSC组以作为内部单元。
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