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1. Intel® Stratix® 10精度可调DSP模块概述
2. 模块体系结构概述
3. 操作模式说明
4. 设计考量
5. Intel® Stratix® 10精度可调DSP模块实现指南
6. Native Fixed Point DSP Intel® Stratix® 10 FPGA IP核参考
7. Multiply Adder IP核参考
8. ALTMULT_COMPLEX Intel® FPGA IP核参考
9. LPM_MULT Intel® FPGA IP核参考
10. Native Floating Point DSP Intel® Stratix® 10FPGA IP参考
11. LPM_DIVIDE (Divider) Intel FPGA IP核
12. Intel® Stratix® 10 精度可调DSP块用户指南文档存档
13. Intel® Stratix® 10精度可调DSP块文档修订历史
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3.2.2.3. Vector Two模式
此模式运行的浮点乘法运算中乘法运算结果被直接送入chainout。来自精度可调DSP模块的chainin输入随后作为输出结果从输入ax 被加入或减去。
Chainin参数 | Vector Two进行浮点加法 | Vector Two进行浮点减法 |
---|---|---|
Disable | result = ax Chainout = ay * az |
result = ax Chainout = ay * az |
Enable | result = ax + chainin Chainout = ay * az |
result = ax - chainin Chainout = ay * az |
浮点vector two模式支持下列异常标记:
- mult_invalid
- mult_inexact
- mult_overflow
- mult_underflow
- adder_invalid
- adder_inexact
- adder_overflow
- adder_underflow
图 22. Intel® Stratix® 10器件的Vector Two模式