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1. Intel® Stratix® 10精度可调DSP模块概述
2. 模块体系结构概述
3. 操作模式说明
4. 设计考量
5. Intel® Stratix® 10精度可调DSP模块实现指南
6. Native Fixed Point DSP Intel® Stratix® 10 FPGA IP核参考
7. Multiply Adder IP核参考
8. ALTMULT_COMPLEX Intel® FPGA IP核参考
9. LPM_MULT Intel® FPGA IP核参考
10. Native Floating Point DSP Intel® Stratix® 10FPGA IP参考
11. LPM_DIVIDE (Divider) Intel FPGA IP核
12. Intel® Stratix® 10 精度可调DSP块用户指南文档存档
13. Intel® Stratix® 10精度可调DSP块文档修订历史
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1.2. Intel® Stratix® 10器件中支持的操作模式
精度可调DSP模块资源 | 操作模式 | 支持的操作实例 | 预加器支持 | 系数支持 | 输入级联支持 | Chainin支持 | Chainout支持 |
---|---|---|---|---|---|---|---|
1个精度可调节DSP模块 | 定点独立18 x 19乘法运算 | 21 | 支持 | 支持 | 支持 2 | 不支持 | 不支持 |
定点独立27 x 27乘法运算 | 1 | 支持 | 支持 | 支持 3 | 支持 | 支持 | |
定点两个18 x 19乘法加法器模式 | 1 | 支持 | 支持 | 支持2 | 支持 | 支持 | |
定点18 x 18乘法加法器通过36-bit输入求和 | 1 | 不支持 | 不支持 | 不支持 | 支持 | 支持 | |
定点18 x 19脉动模式 | 1 | 支持 | 支持 | 支持2 | 支持 | 支持 | |
1个精度可调DSP模块 | 浮点乘法模式 | 1 | 不支持 | 不支持 | 不支持 | 不支持 | 支持 |
浮点加法或减法模式 | 1 | 不支持 | 不支持 | 不支持 | 不支持 | 支持 | |
浮点乘法加法器或减法模式 | 1 | 不支持 | 不支持 | 不支持 | 支持 | 支持 | |
浮点乘法累加模式 | 1 | 不支持 | 不支持 | 不支持 | 不支持 | 支持 | |
浮点矢量一模式(Floating-point vector one mode) | 1 | 不支持 | 不支持 | 不支持 | 支持 | 支持 | |
浮点矢量二模式(Floating point vector two mode) | 1 | 不支持 | 不支持 | 不支持 | 支持 | 支持 | |
2个精度可调DSP模块 | 定点复合18x19乘法运算 | 1 | 不支持 | 不支持 | 不支持 | 不支持 | 不支持 |
4个精度可调DSP模块 | 浮点复合乘法运算 | 1 | 不支持 | 不支持 | 不支持 | 不支持 | 不支持 |
精度可调DSP模块资源 | 操作模式 | 动态ACCUMULATE | 动态LOADCONST | 动态SUB | 动态NEGATE |
---|---|---|---|---|---|
1个精度可调节DSP模块 | 定点独立18 x 19乘法运算 | 不支持 | 不支持 | 不支持 | 不支持 |
定点独立27 x 27乘法运算 | 支持 | 支持 | 不支持 | 支持 | |
定点两个18 x 19乘法加法器模式 | 支持 | 支持 | 支持 | 支持 | |
定点18 x 18乘法加法器通过36-bit输入求和 | 支持 | 支持 | 支持 | 支持 | |
定点18 x 19脉动模式 | 支持 | 支持 | 支持 | 支持 | |
浮点乘法运算模式 | 不支持 | 不支持 | 不支持 | 不支持 | |
浮点加法或减法模式 | 不支持 | 不支持 | 不支持 | 不支持 | |
浮点乘法加法器或减法模式 | 不支持 | 不支持 | 不支持 | 不支持 | |
浮点乘法累加模式 | 支持 | 不支持 | 不支持 | 不支持 | |
浮点矢量一模式(Floating-point vector one mode) | 不支持 | 不支持 | 不支持 | 不支持 | |
浮点矢量二模式(Floating point vector two mode) | 不支持 | 不支持 | 不支持 | 不支持 | |
2个精度可调DSP模块 | 定点复合18 x 19乘法运算 | 不支持 | 不支持 | 不支持 | 不支持 |
4个精度可调DSP模块 | 浮点复合乘法运算 | 不支持 | 不支持 | 不支持 | 不支持 |
1 当器件上或Logic Lock(标准)区域内无足够DSP块时, Intel® Quartus® Prime软件将自动决定两个独立乘法运算的合并。
3 使能预加器性能时,不支持输入级联。