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6.1.6. 器件上电
编号 | 是否完成? | 检查表项目 |
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1 | 设计电路板上电:所有 Intel® Agilex™ GPIO管脚都处于三态,直到器件被配置且配置管脚输出为止。在器件外设被编程之前,收发器管脚处于高阻抗状态。而一旦编程了外设,在收发器校准完成后就立刻设置匹配(termination)和Vcm。 | |
2 | 设计电源电压升至稳定状态。 | |
3 | 设置POR时间以确保供电电源稳定。 | |
4 | 设计电源排序和稳压器以获得最佳器件可靠性。先连接电路板之间的GND然后才连接供电电源。 | |
5 | 将nSTATUS管脚拉高至VCCIO_SDM。请确保上电期间没有外部组件将nSTATUS驱动到低电平。 |
器件上电期间,必须满足上电复位 (POR) 电源的最低电流要求。
Intel® Agilex™ 器件具有上电复位电路(Power-On Reset Circuitry),可将器件保持于复位状态,直至电源输出达到建议的操作范围。该器件还必须在最长电源斜坡时间(power supply ramp time)内达到建议的操作范围。如果不符合斜坡时间,器件I/O管脚和编程寄存器将保持三态,并且器件配置失败。要使 Intel® Agilex™ 器件退出POR,就必须上电VCCBAT电源,即使不使用易失性密钥。
Intel® Agilex™ 器件中,当可选管脚选项设置(MSEL)设置为FAST QSPI模式时,一般POR时间设置为4 ms或100 ms。
Intel® Agilex™ 器件具有上电排序要求。应考虑每个轨(rail)的上电时序和掉电时序以满足电源排序要求。
Intel使用GND作为I/O缓冲器设计的参考电位。先连接电路板之间的GND然后才连接电源,可防止电路板上的GND被电路板上其他组件通过上电路径无意上拉至高位。否则,GND的电位被拉高后,可能导致Intel器件的I/O电压或电流条件超规。