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5.1.6. HPS I/O设置:约束和驱动强度
指南:确保已正确配置HPS Dedicated I/O的I/O设置。
生成包含HPS的Platform Designer系统时,会自动管理管脚位置分配。同样地,HPS EMIF接口的时序和I/O约束也有由PS IP的 Intel® Agilex™ External Memory Interfaces管理。必须以与管理FPGA I/O的相同方式,使用 Intel® Quartus® Prime软件管理HPS Dedicated I/O的以下I/O约束:驱动强度,弱上拉使能和终端匹配设置。任何配置后以使用FPGA I/O的外设,还必须使用 Intel® Quartus® Prime软件进行完全约束,包括管脚位置。