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1.2. PLL概述
锁相环(PLL)对器件时钟管理、外部系统时钟管理以及高速I/O接口提供强健的时钟管理与综合。
Intel® Agilex™ 器件系列包含以下I/O PLL用于内核应用程序。I/O PLL只能用作整数PLL。
- Fabric-feeding I/O PLLs—有3个C计数器输出可用,不支持PLL级联。
- I/O bank I/O PLLs—有7个C计数器输出可用,不支持PLL级联
I/O PLL在与I/O Bank中的硬存储控制器和LVDS串化器/解串器 (SERDES) 块相邻的位置。每个I/O bank包含2个I/O bank I/O PLL和一个架构馈给I/O PLL。