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4.1.3.4. 解串器
解串器由移位寄存器组成。解串因子决定移位寄存器的深度。该解串器根据解串因子将1-bit串行数据流转换成并行数据流。
load_enable是一个频率等于快速时钟除于解串因子的脉冲信号。
图 33. LVDS x8解串器波形
信号 | 说明 |
---|---|
rx_in | LVDS输入数据流到LVDS SERDES IP核通道 |
fast_clock | 用于接收器的时钟 |
load_enable | 使能进行解串的信号 |
rx_out[7:0] | 已解串数据 |