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4.1. IP Catalog和Parameter Editor
4.2. Intel® FPGA IP核安装和许可
4.3. IP常规设置
4.4. 向IP Catalog添加自己的IP
4.5. Intel® FPGA IP的最佳实践
4.6. 生成IP Core ( Intel® Quartus® Prime Pro Edition)
4.7. 修改IP实例
4.8. 升级IP核
4.9. 仿真 Intel® FPGA IP核
4.10. 使用其他EDA工具综合IP核
4.11. 以HDL例化IP核
4.12. 支持IEEE 1735加密标准
4.13. Intel FPGA IP核介绍修订历史
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2.9.3.1. 包含到外部修订控制中的文件
将如下工程文件类型包含到外部修订控制系统:
- 逻辑设计文件(.v, .vdh, .bdf, .edf, .vqm)
- 时序约束文件(.sdc)
- Quartus工程设置和约束(.qdf, .qpf, .qsf)
- IP文件(.ip, .v, .sv, .vhd, .qip, .sip, .qsys)
- Platform Designer生成文件(.qsys, .ip, .sip)
- EDA工具文件(.vo, .vho)
如果使用脚本化设计流程,则请手动生成或修改这些文件。如果使用外部源代码控制系统,请在修改约束和设置时随时检入工程文件。