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您可以使用门控时钟通过有效关闭数字电路中那些未使用的部分来降低某些器件体系结构中的功耗。当门控一个时钟时,由此时钟驱动的时钟网络以及寄存器都将停止翻转,从而消除了它们对功耗的影响。但是,门控时钟不是同步方案的一部分,因此会大大增加设计实现和验证所需的工作量。门控时钟会导致时钟偏斜,并使器件移植变得困难。这些时钟对毛刺也很敏感,这可能会导致设计失败。
请使用专用硬件来执行时钟门控,而不使用AND或OR门。例如,您可以使用较新的Intel FPGA器件中的时钟控制模块来关闭整个时钟网络。专用硬件模块可确保使用低偏斜进行全部布线,并避免由于时钟线上的逻辑延迟而导致器件上的保持时间问题。
从功能的角度来看,您可以使用同步时钟使能信号以纯同步方式关闭时钟域。但是,当使用同步时钟使能方案时,时钟网络会继续翻转。这种方法所降低的功耗不会像在源端对时钟进行门控所降低的功耗那么多。在大多数情况下,请使用同步方案。