Intel® Cyclone® 10 LP器件数据手册

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ID 683251
日期 5/08/2017
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Cyclone® 10 LP器件数据表
Cyclone® 10 LP器件数据表 x
操作条件 功耗 开关特性 I/O时序 术语表 文档修订历史
操作条件 x
绝对最大额定值 所允许的最大过冲或下冲电压 建议的操作条件 ESD性能 DC特性 I/O标准规范
DC特性 x
电源电流 总线保持 OCT规范 管脚电容 内部弱上拉和弱下拉电阻 热插拔 Schmitt触发器输入
I/O标准规范 x
单端I/O标准规范 单端SSTL和HSTL I/O参考电压规范 单端SSTL和HSTL I/O标准信号规范 差分SSTL I/O标准规范 差分HSTL I/O标准规范 差分I/O标准规范
开关特性 x
内核性能规范 外设性能
内核性能规范 x
时钟树规范 PLL规范 嵌入式乘法器规范 存储器模块规范 配置和JTAG规范
外设性能 x
高速I/O规范 占空比失真规范 OCT校准时序规范 IOE可编程延迟
高速I/O规范 x
RSDS发送器时序规范 仿真RSDS_E_1R发送器时序规范 Mini-LVDS发送器时序规范 真LVDS发送器时序规范 仿真LVDS发送器时序规范 LVDS接收器时序规范
Cyclone® 10 LP器件数据表

外设性能

I/O性能支持多种系统接口，例如高速I/O接口和PCI/PCI-X总线接口。使用通用I/O标准的I/O。例如3.3-，3.0-，2.5-，1.8-，或1.5-LVTTL/LVCMOS适用于采用10 pF负载的典型200 MHz接口频率。
注： 实际可达到的频率取决于设计和系统具体因素。根据具体的设计和系统设置来执行HSPICE/IBIS仿真，以确定在您的系统中能达到的最大频率。
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