仅对英特尔可见 — GUID: mwh1410384386941
Ixiasoft
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8.12. 用户界面设置参考
Transceiver Toolkit用户界面包含以下设置:
设置 | 描述 | 器件系列 | 控制窗格 | ||||||||
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Alias | 您选择的通道名称。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Auto Sweep status | 报告当前和最佳测试的比特,错误,误码率以及当前Auto Sweep测试的实例数量(case count)。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Bit error rate (BER) | 错误数除以自上次检查器复位后的已测试比特数。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Channel address | 收发器通道的逻辑地址编号。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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CTLE AC Gain | 指定接收器的Continuous Time Linear Equalization (CTLE) AC Gain。AC增益的整个范围从峰值频率(setting 0)上的约-2 dB到峰值频率(setting 15)上的+10 dB。 | Intel® Stratix® 10 L- and H-Tile | 接收器窗格 | ||||||||
CTLE EQ Gain | 指定接收器的CTLE EQ Gain。EQ增益的整个范围从峰值频率(setting 0)上的约0 dB到峰值频率(setting 47)上的-16 dB。 | Intel® Stratix® 10 L- and H-Tile | 接收器窗格 | ||||||||
CTLE DFE mode |
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Intel® Arria® 10和 Intel® Cyclone® 10 GX | 接收器窗格 | ||||||||
Data rate | 在工程文件中显示的通道的数据速率,或者频率检测器测量的数据速率。 要使用频率检测器,需要在Data Pattern Checker IP core或者Data Pattern Generator IP core中开启Enable Frequency Counter,重新生成IP内核,然后重新编译设计。 测得的数据速率取决于工程文件中显示的 Avalon® 管理时钟频率。 如果对设置进行更改,并且想对数据速率进行再次采样,那么单击Data rate旁边的 Refresh按钮。 |
所有支持的器件系列 | 发送器窗格 接收器窗格 |
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DC gain | 对整个频谱中的输入信号提供均等提升。 | Intel® Arria® 10和 Intel® Cyclone® 10 GX | 接收器窗格 | ||||||||
DFE mode | 用于改进信号质量的决策反馈均衡(DFE)。
在 Intel® Arria® 10器件中,DFE模式为Off,Manual和 Adaptation Enabled。Adaptation Enabled模式的DFE会自动尝试查找最佳布线值(best tap value)。 |
Intel® Arria® 10 and Intel® Cyclone® 10 GX | 接收器窗格 | ||||||||
E-Tile Adaptation Mode | 指定接收器均衡器参数的调整模式:
注: 当运行One-Time Adaptation Mode时,要确保BER测量没有同时运行。
在适配(adaptation)完成前要要一直按下Start One-Time按钮。 |
Intel® Stratix® 10 E-Tile | 接收器窗格 | ||||||||
Equalization control | 增强输入信号的高频增益,以补偿物理介质的低通滤波器效应。此选项与DFE一起使用时,要在 Manual或者Adaptation Enabled模式下使用DFE。 |
Intel® Arria® 10和 Intel® Cyclone® 10 GX | 接收器窗格 | ||||||||
Equalization mode | 对于 Intel® Arria® 10器件,Equalization Mode可设置成Manual或者Triggered。 |
Intel® Arria® 10和 Intel® Cyclone® 10 GX | 接收器窗格 | ||||||||
Error rate limit | 开启或关闭错误率限制(error rate limit)。Start checking after指定工具包在查看接下来两个检查的误码率(BER)之前等待的比特数。 Bit error rate achieves below设置误码率上限。如果错误率好于设置的错误率,那么测试结束。 Bit error rate exceeds设置误码率下限。如果错误率坏于设置的错误率,那么测试结束。 |
所有支持的器件系列 | 接收器窗格 | ||||||||
Generator/Checker mode | 指定Data pattern checker或者Serial bit comparator用于BER测试。 如果使能Serial bit comparator,那么Data Pattern Generator发送PRBS码型, serial bit comparator会检查此码型。 在Bypass mode中,点击Start开始Serial bit comparator上计数。 对于BER测试:
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所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Increase test range | 对于所选的一组控制,减少一个单位来增加测试范围(最小),增加一个单位来增加测试范围(最大)。您可以跨越PMA Analog控制(非DFE控制)或DFE控制。您可以快速设置一个测试以检查是否有任何接近您当前最佳设置的PMA设置组合能产生更好的结果。 右键点击Advanced面板使用此选项 |
所有支持的器件系列 | 接收器窗格 | ||||||||
Maximum tested bits | 设置每个测试迭代的最大测试比特数。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Number of bits tested | 指定自上次检查器复位后的测试的比特数。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Number of error bits | 指定自上次检查器复位后出现的错误比特数。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
PLL refclk freq | 出现在工程文件中的通道参考时钟频率,或者从测得的数据速率计算出的参考时钟频率。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Populate with | 右键点击Advanced面板,加载器件的当前值作为起点,或者初步加载auto sweep确定的最佳设置。 Intel® Quartus® Prime软件自动应用在下拉列表中指定的Transmitter settings和Receiver settings值。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Preamble word | 使用前同步码模式(preamble mode)时要发出的字(仅在使用soft PRBS Data Pattern Generator和Checker时)。 | 所有支持的器件系列 | 发送器窗格 | ||||||||
Pre-emphasis | 该可编程模块可增强每个发送缓冲信号发送数据中的高频。此行为抵消了传输介质中可能的衰减。 |
所有支持的器件系列 | 发送器窗格 | ||||||||
Receiver channel | 指定所选接收器通道的名称。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Refresh Button | 加载.pof文件后,运行动态重配置后从寄存器加载新设置。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Reset | 复位当前测试。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Rules Based Configuration (RBC) validity checking | 根据以前的设置,以红色显示Transmitter settings和Receiver settings下每个列表的设置的无效组合。 使能此选项时,红色显示的设置表示当前组合无效。此操作避免了手动测试无法针对设计进行编译的无效设置,并避免了将器件长时间设置为无效模式并可能损坏电路。 |
Intel® Arria® 10 Intel® Cyclone® 10 GX Intel® Stratix® 10 L- and H-Tile |
接收器窗格 | ||||||||
Run length | 设置测试运行的覆盖率(coverage)参数。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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RX CDR PLL status | 在lock-to-reference (LTR)模式下显示接收器。在auto-mode下,如果数据不能被锁定,那么此信号在LTD模式下切换(如果CDR锁定到数据)。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
RX CDR data status | 在lock-to-data (LTD)模式下显示接收器。在auto-mode下,如果数据不能被锁定,那么此信号锁定到数据时保持在高电平,并且不会切换。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Serial loopback enabled | 在缓冲器之前插入一个串行环回,使您能够在器件的同一物理通道上的发送器和接收器对上形成一条链路。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Start | 启动通道上的pattern generator或者checker以验证输入数据。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Stop | 停止生成码型和测试通道。 | 所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Test pattern | 发送器通道发送的测试码型。
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所有支持的器件系列 | 发送器窗格 接收器窗格 |
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Time limit | 指定时间限制单位和值,使每次测试迭代都有最大边界时间限制。 | 所有支持的器件系列 | 接收器窗格 | ||||||||
Transmitter channel | 指定所选发送器通道的名称。 | 所有支持的器件系列 | 发送器窗格 | ||||||||
TX/CMU PLL status | 指定发送器通道PLL是否锁定到参考时钟。 | 所有支持的器件系列 | 发送器窗格 | ||||||||
Use preamble upon start | 如果打开,则在测试码型之前发送前导字。如果关闭,则立即开始发送测试码型。 | 所有支持的器件系列 | 发送器窗格 | ||||||||
VGA | 可变增益放大器(VGA)放大信号幅度并确保在数据进入Clock Data Recovery (CDR)模块进行采样之前的恒定电压摆幅。此分配控制VGA输出电压摆幅,并允许值介于0到7之间。 | Intel® Arria® 10和 Intel® Cyclone® 10 GX | 接收器窗格 | ||||||||
VGA DC gain | 指定接收器的VGA Gain。VGA gain的整个范围从峰值频率(setting 0)上的约-5 dB到+7 dB (setting 31)。 | Intel® Stratix® 10 L- and H-Tile | 接收器窗格 | ||||||||
VOD control | 可编程发送器差分输出电压。 | 所有支持的器件系列 | 发送器窗格 |