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1. 系统调试工具概述
2. 使用Signal Tap逻辑分析仪进行设计调试
3. Quick Design Verification with Signal Probe
4. 使用外部逻辑分析器进行在系统调试(In-System Debugging Using External Logic Analyzers)
5. 存储器和常量的在系统修改(In-System Modification of Memory and Constants)
6. 使用In-System Sources and Probes进行设计调试
7. 使用System Console分析和调试设计
8. 调试收发器链路
9. Intel® Quartus® Prime Pro Edition用户指南调试工具存档
A. Intel® Quartus® Prime Pro Edition用户指南
2.1. Signal Tap逻辑分析仪
2.2. Signal Tap Logic Analyzer任务流程概述
2.3. 配置Signal Tap Logic Analyzer
2.4. 定义触发器
2.5. 编译设计
2.6. 对目标器件或者器件编程
2.7. 运行Signal Tap Logic Analyzer
2.8. 查看,分析和使用采集的数据
2.9. 使用Signal Tap Logic Analyzer调试部分重配置设计
2.10. 使用Signal Tap Logic Analyzer调试基于模块的设计
2.11. 其他功能
2.12. 设计实例:使用Signal Tap Logic Analyzers
2.13. 自定义触发流程应用示例
2.14. Signal Tap脚本支持
2.15. 使用Signal Tap Logic Analyzer进行设计调试修订历史
7.1. System Console简介
7.2. System Console调试流程
7.3. 与System Console交互的IP内核
7.4. 启动System Console
7.5. System Console GUI
7.6. System Console命令
7.7. 在命令行模式下运行System Console
7.8. System Console服务
7.9. System Console示例和教程
7.10. 板载 Intel® FPGA Download Cable II支持
7.11. 系统验证流程中的MATLAB*和Simulink*
7.12. 不推荐使用的命令
7.13. 使用System Console分析和调试设计修订历史
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2.7. 运行Signal Tap Logic Analyzer
调试Signal Tap logic analyzer与使用一个外部逻辑分析器相类似。 通过开始一个分析来初始化逻辑分析器。发生触发事件时,逻辑分析器将采集的数据存储在器件的存储器缓存中,然后通过JTAG连接将该数据传输到.stp文件。
您还可以执行与强制触发指令等效的操作,该指令使您可以查看缓存中当前采集的数据,而不会发生触发事件。
下面流程图显示了如何操作Signal Tap logic analyzer。指示Power-Up和Runtime Trigger事件发生在何处以及何时可以从这些事件中采集的数据进行分析。
图 58. Power-Up和Runtime Trigger事件流程图
您也可以使用In-System Sources and Probes和Signal Tap logic analyzer一起来强制触发条件。In-System Sources and Probes功能使您能够通过JTAG链对所选信号上的值进行驱动和采样。