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10.5.1. ebfm_barwr规程
10.5.2. ebfm_barwr_imm处理过程
10.5.3. ebfm_barrd_wait处理过程
10.5.4. ebfm_barrd_nowt处理过程
10.5.5. ebfm_cfgwr_imm_wait处理过程
10.5.6. ebfm_cfgwr_imm_nowt处理过程
10.5.7. ebfm_cfgrd_wait处理过程
10.5.8. ebfm_cfgrd_nowt处理过程
10.5.9. BFM配置处理过程
10.5.10. BFM共享存储器访问处理过程
10.5.11. BFM日志和消息处理过程
10.5.12. Verilog HDL格式化函数
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1.8. PCI Express IP核封装布局
Intel® Stratix® 10器件具有在不同的收发器tile上实现的高速收发器。收发器tile位于器件的左右侧。
每个24通道收发器L-tile或H-tile都包含一个采用硬逻辑实现的x16 PCIe IP核。下图显示 Intel® Stratix® 10器件中的PCIe IP核布局。L-tile和H-tile均为橙色。E-tile为绿色。
图 3. Intel® Stratix® 10 GX/SX器件具有4个PCIe Hard IP核和96个收发器通道
图 4. Intel® Stratix® 10 GX/SX器件具有2个PCIe Hard IP核和48个收发器通道
图 5. Intel® Stratix® 10 GX/SX器件具有2个PCIe Hard IP核和48个收发器通道-收发器位于两侧
图 6. Intel® Stratix® 10移植器件具有2个收发器Tile和48个收发器通道
图 7. Intel® Stratix® 10 GX/SX器件具有1个PCIe Hard IP核和24个收发器通道
图 8. Intel® Stratix® 10 TX器件具有1个PCIe Hard IP核和144个收发器通道
图 9. Intel® Stratix® 10 TX器件具有1个PCIe Hard IP核和96个收发器通道
图 10. Intel® Stratix® 10 TX器件具有2个PCIe Hard IP核和72个收发器通道
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