仅对英特尔可见 — GUID: nik1410565018050
Ixiasoft
10.5.1. ebfm_barwr规程
10.5.2. ebfm_barwr_imm处理过程
10.5.3. ebfm_barrd_wait处理过程
10.5.4. ebfm_barrd_nowt处理过程
10.5.5. ebfm_cfgwr_imm_wait处理过程
10.5.6. ebfm_cfgwr_imm_nowt处理过程
10.5.7. ebfm_cfgrd_wait处理过程
10.5.8. ebfm_cfgrd_nowt处理过程
10.5.9. BFM配置处理过程
10.5.10. BFM共享存储器访问处理过程
10.5.11. BFM日志和消息处理过程
10.5.12. Verilog HDL格式化函数
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Ixiasoft
10.5.11.2. ebfm_log_stop_sim Verilog HDL函数
ebfm_log_stop_sim处理过程停止仿真。
位置 |
altrpcietb_bfm_log.v |
|
---|---|---|
Syntax(句法) |
Verilog HDL: return:=ebfm_log_stop_sim(success); |
|
Argument(自变量) |
success | 设为1时,此过程通过一条表明成功完成的消息来停止仿真。此消息带一个前缀SUCCESS。 否则,该处理停止仿真并通过消息表明未成功完成。该消息以FAILURE为前缀。 |
Return(回送) |
始终为0 |
此值仅应用于Verilog HDL函数。 |