仅对英特尔可见 — GUID: ifs1488511321496
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DCLK到DATA[] = 1的FPP配置时间
注: 使能解压缩或设计安全功能时,用于FPP ×8、FPP ×16和FPP ×32的DCLK到DATA[]比率各不相同。对于各自相应的DCLK到DATA[]比率,请参阅 Intel® Cyclone® 10 GX器件的DCLK到DATA[]比率表。
符号 | 参数 | 最小 | 最大 | 单位 |
---|---|---|---|---|
tCF2CD | nCONFIG low to CONF_DONE low | 480 | 1,440 | ns |
tCF2ST0 | nCONFIG low to nSTATUS low | 320 | 960 | ns |
tCFG | nCONFIG low pulse width | 2 | — | μs |
tSTATUS | nSTATUS low pulse width | 268 | 3,000 70 | μs |
tCF2ST1 | nCONFIG high to nSTATUS high | — | 3,000 71 | μs |
tCF2CK 72 | nCONFIG high to first rising edge on DCLK | 3,010 | — | μs |
tST2CK 72 | nSTATUS high to first rising edge of DCLK | 10 | — | μs |
tDSU | DATA[] setup time before rising edge on DCLK | 5.5 | — | ns |
tDH | DATA[] hold time after rising edge on DCLK | 0 | — | ns |
tCH | DCLK high time | 0.45 × 1/fMAX | — | s |
tCL | DCLK low time | 0.45 × 1/fMAX | — | s |
tCLK | DCLK period | 1/fMAX | — | s |
fMAX | DCLK frequency (FPP ×8/×16/×32) | — | 100 | MHz |
tCD2UM | CONF_DONEhigh to user mode 73 | 175 | 830 | μs |
tCD2CU | CONF_DONE high to CLKUSR enabled | 4 x最大DCLK周期 | — | — |
tCD2UMC | CONF_DONE high to user mode with CLKUSR option on | tCD2CU + (600 × CLKUSR周期) | — | — |
相关信息
70 如果不通过扩展nCONFIG或nSTATUS低脉冲宽度来延迟配置,则可使用该值。
71 如果不通过从外部保持nSTATUS低电平来延迟配置,则可使用该值。
72 如果nSTATUS被监控,则遵循tST2CK规范。如果nSTATUS未被监控,则可遵循tCF2CK规范。
73 最小和最大数量仅在选择内部振荡器作为初始化器件的时钟源时适用。