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2.2.2.2. HPS至FPGA AXI-4主接口
HPS-to-FPGA AXI* -4 Master接口允许HPS主接口向FPGA架构发布事务。可使用:
- Enable/Data Width下拉菜单将主接口宽度配置为32位,64位,或128位。
- Bridge address width可配置为32至20位。该桥接使能后,使得接口h2f_axi_master,h2f_axi_clock和 h2f_axi_reset可用。
该桥接接受来自FPGA架构的时钟输入并内部执行时钟域跨接。外露的 AXI* 接口所运行的时钟域与由FPGA架构提供的时钟相同。FPGA架构中的其他接口标准,例如连接 Avalon® -MM接口,可通过使用软逻辑适配得到支持。Platform Designer系统集成工具自动生成适配器逻辑以将 AXI* 连接到 Avalon® -MM接口。