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2.3.1.2. FPGA-to-HPS时钟源
开启Enable FPGA-to-HPS free clock选项使能f2h_free_clk时钟输入。这个是主HPS的备用输入,从FPGA架构驱动而来,而非专用 hps_osc_clk管脚。是否开启Enable FPGA-to-HPS free clock选项要视对该管脚的需求而定。
图 14. Platform Designer FPGA-to-HPS时钟源子窗口
有关该时钟的更多信息,请参阅 Intel® Agilex™ 器件数据表。
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