Intel® Agilex™ 硬核处理器系统组件参考手册

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ID 683581
日期 9/30/2019
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文档目录
文档目录 x
1. Intel® Agilex™ 硬核处理器系统组件简介 2. 配置 Intel® Agilex™ 硬核处理器系统组件
1. Intel® Agilex™ 硬核处理器系统组件简介 x
1.1. Cortex*-A53 MPCore* 处理器 1.2. CoreSight* 调试组件 1.3. 互连 1.4. FPGA桥接 1.5. 存储控制器 1.6. 支持外设 1.7. HPS组件介绍修订历史
1.6. 支持外设 x
1.6.1. 接口外设 1.6.2. 片上存储器
2. 配置 Intel® Agilex™ 硬核处理器系统组件 x
2.1. 参数化HPS组件 2.2. FPGA接口 2.3. HPS时钟和复位 2.4. HPS EMIF 2.5. I/O延迟 2.6. Pin MUX和外设 2.7. 生成和编译HPS组件 2.8. 使用Address Span Extender组件 2.9. 配置HPS组件修订历史
2.2. FPGA接口 x
2.2.1. 通用接口 2.2.2. HPS-FPGA AXI桥接 2.2.3. HPS引导源 2.2.4. DMA控制器接口 2.2.5. 中断
2.2.1. 通用接口 x
2.2.1.1. 使能MPU Standby和Event接口 2.2.1.2. 使能通用信号 2.2.1.3. 使能调试APB接口 2.2.1.4. 使能System Trace Macrocell (STM) Hardware Events 2.2.1.5. 使能FPGA交叉触发接口 2.2.1.6. 使能DDR Arm* Trace Bus (ATB)
2.2.2. HPS-FPGA AXI桥接 x
2.2.2.1. FPGA-to-HPS从接口 2.2.2.2. HPS至FPGA AXI-4主接口 2.2.2.3. 轻型HPS至FPGA主接口
2.2.5. 中断 x
2.2.5.1. FPGA-to-HPS 2.2.5.2. HPS-to-FPGA
2.3. HPS时钟和复位 x
2.3.1. 输入时钟 2.3.2. 内部时钟和输出时钟 2.3.3. 复位
2.3.1. 输入时钟 x
2.3.1.1. 外部时钟源 2.3.1.2. FPGA-to-HPS时钟源 2.3.1.3. 外设FPGA时钟
2.3.2. 内部时钟和输出时钟 x
2.3.2.1. 主PLL输出时钟–所需频率 2.3.2.2. HPS至FPGA用户时钟 2.3.2.3. HPS外设时钟–所需频率 2.3.2.4. 时钟源 2.3.2.5. PLL报告
2.6. Pin MUX和外设 x
2.6.1. Pin Mux GUI 2.6.2. Pin Mux Report 2.6.3. EMAC ptp Interface
2.6.1. Pin Mux GUI x
2.6.1.1. Auto-Place IP 2.6.1.2. Advanced
1. Intel® Agilex™ 硬核处理器系统组件简介
2. 配置 Intel® Agilex™ 硬核处理器系统组件

2.2.1.1. 使能MPU Standby和Event接口

Microprocessor Unit（MPU，微处理器单元）备用信号是向FPGA架构发送的提示信号，表示MPU处于备用状态。Event信号将 Cortex*-A53处理器从wait-for-event（WFE）状态唤醒。开启Enable MPU Standby and Event Interfaces选项使能h2f_mpu_events管道，而该管道由如下信号组成：
  • h2f_mpu_eventi—FPGA的输入，用与向所有处理器发出事件信号。该FPGA-to-HPS信号用于唤醒处于WFE状态中的处理器。置位该信号与在 Cortex*-A53中执行SEV指令具有相同的效果。必须在配置FPGA架构时解除置位该信号。且必须在至少2个MPU时钟周期内将该信号置位为高电平，以便处理器识别 Cortex*-A53核。
  • h2f_mpu_evento—MPU核输出到FPGA架构。当其中一个 Cortex*-A53处理器执行SEV指令时，此HPS-to-FPGA信号被置位。由于该信号作为多周期脉冲输出，因此FPGA中的逻辑应使用上升沿检测器来检测事件的发生。
  • h2f_mpu_standbywfe[3:0]—每个处理器的输出，表示处理器是否处于WFE standby（备用）模式。显示为高时，处理器为WFE备用模式。
  • h2f_mpu_standbywfi[3:0]—每个处理器的输出，表示处理器是否处于wait-for-interrupt（WFI，等待中断）备用模式。当逻辑水平为高时，处理器为WFI备用模式。
图 6.  Platform Designer使能MPU信号
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