仅对英特尔可见 — GUID: sss1440054160616
Ixiasoft
6.3. 部分重配置
部分重配置(PR)使您能够动态地对一部分FPGA进行重配置,而其余的FPGA设计则会继续运行。在设计的一个区域中可以定义多种不同的重配置,对区域以外的操作不会造成影响。这种方法对多种功能的系统有效,包括在相同的FPGA器件资源中分时(time-share)的功能。PR使得更多复杂的FPGA系统得以实现。
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部分重配置(PR)使您能够动态地对一部分FPGA进行重配置,而其余的FPGA设计则会继续运行。在设计的一个区域中可以定义多种不同的重配置,对区域以外的操作不会造成影响。这种方法对多种功能的系统有效,包括在相同的FPGA器件资源中分时(time-share)的功能。PR使得更多复杂的FPGA系统得以实现。