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4.4. 高噪声稳压器情况下的R-Tile电源轨板级连接和LC滤波器建议
R-Tile需要严格的连接要求，以免需要断电顺序（PDS）控制电路。电路板连接显示如下，R-Tile删除了PDS要求（例如 Intel® Stratix® 10器件系列中的PDS要求）—不要求电压轨上有下拉放电FET或电阻器。因此， 英特尔Agilex® 7器件是一个无PDS的FPGA，E-Tile除外。
对于VCCRT_GXR电源轨，是按照建议的LTC7151S稳压器而设计的（建议使用500 KHZ开关频率），它具有非常严格的噪声规范，您不需要为该电源轨添加滤波器（请参考建议的电源树）。然而，如果使用了噪声较大的开关稳压器，则需要精心设计滤波器来抑制电源轨中的噪声。执行PDN瞬态仿真并根据规范验证该电源轨设计。
如果您使用LDO稳压器来满足该电源轨的严格噪声规范，建议的LDO是2x ADP1765，使用LDO时也无需添加LC滤波器。
VCCRT_GXR允许的最大稳压器（VR）电压纹波为5mV，VCCH_GXR为7mV。如果您选择了高噪声的VR而无法满足R-Tile电源轨的VR纹波规范，Intel建议使用建议的LC滤波器来阻挡噪声。
图 27. 按照每个Tile的VCCH_GXR的连接要求和滤波器建议在使用高噪声开关稳压器的情况下。