Stratix 10器件,高速信号接口布局设计指南

ID 683132
日期 5/08/2017
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2.4 mm实例设计性能

前面章节中布局设计策略显示了在连接器区域中的实现。

图 95. TX0通道的Arria10器件SI开发套件通道布局总走线长度约为4.5 inch,不包括连接器。
图 96. 来自连接器的放大的单端TDR测量以下测量中使用的TDR rise time< 17 ps。

信号通孔阻抗达到最小值 45 Ω,通过从信号通孔到主内层布线的转换达到55 Ω。

图 97. 单端散射参数S21和S22 (从连接器)

单端插入损耗约为5 dB,回波损耗在14 GHz上约为-12 dB。