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4.10. 通信端口
Intel® Stratix® 10 GX收发器信号完整性开发板支持10/100/1000 BASE-T Ethernet连接,通过Marvell 88E1111 PHY器件和 Intel® Triple-Speed Ethernet Megacore MAC功能来实现。该器件是自动协商的Ethernet PHY,带有连接到FPGA的SGMII。
Intel® Stratix® 10 GX FPGA器件能够以高达1.25 Gbps的速率与LVDS接口进行通信。FPGA提供的MAC功能用于典型的网络应用。Marvell 88E1111 PHY使用2.5 V和1.2 V的电源轨,并要求从专用振荡器中驱动25-MHz的参考时钟。它连接到一个具有内部磁性的RJ-45连接器,用于驱动Ethernet流量的铜线。
图解信号名称 | Marvell 88E1111 (U23) PHY管脚编号 | 说明 |
---|---|---|
ENET_LED_LINK1000 | 60/73 | 1000 Mb链接LED |
ENET_LED_LINK100 | 74 | 100 Mb链接LED |
ENET_LED_LINK10 | 59/76 | 10 Mb链接LED |
ENET_LED_TX | 68 | TX数据有效LED |
ENET_LED_RX | 69 | RX数据有效LED |
ENET_SGMII_TX_P | 82 | SGMII发送 |
ENET_SGMII_TX_N | 81 | SGMII发送 |
ENET_SGMII_RX_P | 77 | SGMII接收 |
ENET_SGMII_RX_N | 75 | SGMII接收 |
ENET_XTAL_25MHZ | 55 | 25 MHz时钟 |
ENET_T_INTn | 23 | 管理总线中断 |
ENET_RSET | 30 | 器件复位 |
MDIO_T | 24 | 管理总线数据输入/输出 |
MDC_T | 25 | 管理总线数据时钟 |
MDI_P0 | 29 | 管理总线数据 |
MDI_N0 | 31 | 管理总线数据 |
MDI_P1 | 33 | 管理总线数据 |
MDI_N1 | 34 | 管理总线数据 |
MDI_P2 | 39 | 管理总线数据 |
MDI_N2 | 41 | 管理总线数据 |
MDI_P3 | 42 | 管理总线数据 |
MDI_N3 | 43 | 管理总线数据 |