Quartus® Prime 设计软件
直观的高性能设计环境。从设计输入和合成到优化、验证和模拟，Quartus® Prime 设计软件借助数百万个逻辑元件大幅增强设备的功能，为设计师提供把握新一代设计机遇所需的理想平台。
Chip Planner
通过允许您查看和限制 FPGA 芯片资源视觉显示中的设计逻辑，Chip Planner 简化了平面布局。运行 Fitter 后，您可以使用 Chip Planner 来查看和修改逻辑布局、连接和布线路径。
Interface Planner
Interface Planner 用于探索设备的外设架构，并高效地分配接口。Interface Planner 通过实时进行拟合和合法性检查来防止非法引脚分配。
Signal Tap 逻辑分析器
Signal Tap 逻辑分析器会捕获并显示 FPGA 设计中的实时信号行为，以便您在正常设备运行期间探测和调试内部信号的行为，而无需额外的 I/O 引脚或外部实验室设备。
Questa*-英特尔® FPGA 版软件
Questa*-英特尔® FPGA 和 Questa*-英特尔® FPGA 入门版软件是面向 Altera® FPGA 设备的 Siemens EDA Questa* Core 软件版本。
英特尔® HLS 编译器
英特尔® HLS 编译器是一款高级合成 (HLS) 工具，可利用不定时 C++ 作为输入，生成针对 Altera® FPGA 优化的生产质量寄存器传输级 (RTL) 代码。
面向 Altera® FPGA 的 DSP Builder
DSP Builder 是一款数字信号处理设计工具，支持从 MathWorks Simulink 环境直接向 Altera® FPGA 生成 DSP 算法的硬件描述语言代码。
面向 Altera® FPGA 的 Nios® 软核处理器
Nios® 软核处理器专为 Altera® FPGA 而设计。软核处理器系列适用于从数字信号处理到系统控制的一系列嵌入式计算应用。
Altera® SoC FPGA 嵌入式开发套件 (EDS)
Altera® SoC FPGA EDS 是一个全面的工具套件，适用于在 Altera® SoC FPGA 上进行嵌入式软件开发。它包含开发工具、实用程序、运行时软件以及应用示例。
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