用于 FIR 编译器的 Verilog 复位系数

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此设计示例展示了使用有限脉冲响应 (FIR) 编译器 IP MegaCore 函数时如何从文件复位系数。FIR 编译器提供在运行时更改系数的灵活性。当 FIR 编译器使用一组系数处理数据时,您可以在不停止内核处理的情况下复位另一组系数。

为了优化芯片效率,系数不会以其自然顺序进行存储。此示例说明了使用预编译可执行的 coef_seq.exe 重新排序系数的步骤。此滤波器使用了四组系数:低通、高通、带通和带阻滤波器。前两个在 IP 工具平台中参数化;后两个必须在运行时复位,并且需要提前重新排序。提供的测试平台向您展示了如何设置控件来复位系数,以便满足计时要求。

下载本示例中使用的文件:

该设计的使用受英特尔® 设计示例许可协议中条款和条件的管理和约束。

zip 下载中的文件包括:

  • fir91.v - FIR 编译器 wrapper 文件
  • coef_reload_tb.v - 测试平台文件
  • coef_reload_msim.tcl - 使用 ModelSim* 工具运行功能模拟的 Tcl 脚本
  • coef_seq.exe - 重新排序系数的 Windows 可执行文件

图 1.FIR 编译器端口列表。