文章 ID: 000082089 内容类型: 故障排除 上次审核日期: 2018 年 10 月 30 日

为什么在编译适用于 PCI Express* IP Core 18.1 的英特尔® Stratix® 10 硬 IP 时报告的最低脉冲宽度时序违规信息消息?

环境

    英特尔® Quartus® Prime Pro Edition
    适用于 PCI Express* 的 Avalon-MM 英特尔® Stratix® 10 硬核 IP
    适用于 PCI Express* 的 Avalon-ST 英特尔® Stratix® 10 硬核 IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT

关键问题

说明

由于 PCI Express* IP 内核 18.1 版的英特尔® Stratix® 10 硬 IP 出现问题,可以在编译过程中观察最小脉冲宽度时序违规信息消息。

 

 

解决方法

可以安全地忽略此消息。

此问题从英特尔® Quartus® Prime Pro Edition 软件版本 19.1 开始修复。

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本文适用于 1 产品

英特尔® Stratix® 10 FPGA 和 SoC FPGA

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