文章 ID: 000077425 内容类型: 故障排除 上次审核日期: 2021 年 08 月 27 日

为什么面向 PIPE 通道极性反转的Stratix 10 原生 PHY IP 内核无法立即生效?

环境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
说明

如果发现pipe_rx_polarity反转通道极性,第 1/2 代最多需要 24 个 PCLK,而不是最多 20 个 PCLK,反转数据就会出现在rx_parallel_data总线上。

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英特尔® Stratix® 10 FPGA 和 SoC FPGA

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