如果您将输入时钟信号分配到专用时钟引脚位置并进行全局时钟 (GCLK) 分配到此时钟,您可能会收到此错误消息。
如果从输入时钟引脚到 PLL 的路由不专用并使用 GCLK 网络,则需要在输入时钟引脚和 PLL 之间添加 ALTCLKCTRL mega 功能,以在设计中实现成功的拟合。
不建议使用从输入时钟引脚到 PLL 的非专用路由,预计会出现此错误消息。原因是这可能会带来抖动,而 TimeQuest 不会提供准确的补偿延迟图。
英特尔® Quartus®软件 13.1 版解决了此问题
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