英特尔® FPGA IP 认证
英特尔致力于提供可与英特尔® FPGA 工具或接口规范无缝协作的知识产权 (IP) 内核，以便于用户能够快速轻松地完成他们的设计。英特尔可以授予 IP 内核以下一项或项多认证。
符合 Platform Designer 标准
Platform Designer 标准认证的对象是那些可与 Quartus® II 或英特尔® Quartus Prime 设计软件中所包含的 Platform Designer 实现无缝集成的知识产权 (IP) 内核。符合 Platform Designer 标准的内核支持行业标准互连接口，包括 Avalon® Memory-Mapped (Avalon-MM)、Avalon Streaming (Avalon-ST)、ARM* AXI3*、AXI4*、AXI4-lite*、AXI4 Stream*、APB* 以及 AHB*。
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Platform Designer 标准对 IP 内核的认证要求
IP 内核必须满足以下要求才能获得 Platform Designer 标准认证：
- 通过上述行业标准互连接口可与系统互连结构进行互连。
- 通过 hw.tcl 可实现 Platform Designer 即插即用集成。
只要满足上述要求，英特尔 FPGA 设计解决方案网络成员就可以认证其 IP 内核符合 Platform Designer 标准。
验证说明
符合 Platform Designer 标准的 IP 内核已经通过每个 Avalon-ST 或 Avalon-MM 接口上的 Avalon Monitor 组件的验证，并且没有违反协议。
硬件设计示例
IP 内核还包含一个使用 Platform Designer 创建的设计示例，用以说明该 IP 内核与 Platform Designer 的正确交互情况。
具有 DSP Builder 应用资质
英特尔将 DSP Builder 应用资质认证授予那些可与 Intel FPGA 软件的 DSP Builder 实现即插即用集成的 IP 内核。英特尔 FPGA 的 DSP Builder 通过帮助您在算法友好的开发环境中创建 DSP 设计的硬件表征来缩短数字信号处理 (DSP) 设计周期。您可以将现有的 MATLAB/Simulink 模块与用于英特尔 FPGA 的 DSP Builder 或英特尔 FPGA IP 模块相结合，以验证系统级规范并生成硬件实现文件。安装了具有 DSP Builder 应用资质的 IP 后，在英特尔 FPGA 的 DSP Builder 模块集之下的 Simulink 库浏览器中会出现一个符号。
I-Tested
在竞争日益激烈的市场中，硬件设计人员必须将时间和精力集中在能为产品带来性能强化和差别化的设计上，而不是实现行业标准协议或接口的设计上。因此，嵌入式知识产权 (IP) 内核已成为满足标准协议和接口逻辑需求的热门方式。为了确保 IP 内核满足复杂协议的功能要求或接口的关键 I/O 时序要求，必须进行硬件验证。
英特尔® 向英特尔 FPGA IP 或英特尔 FPGA 设计解决方案网络会员 IP 内核提供互操作性测试或 I-Tested 认证，这些 IP 内核已在英特尔 FPGA 评估板上通过了必要的 ASSP、硬件组件或测试设备验证，以确保其能够实现符合必要协议要求的交互性。
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I-Tested 内核的认证要求
英特尔要求 IP 内核须符合以下要求，才能通过 I-Tested 认证：
- 成功通过了英特尔 FPGA 评估板的互操作性测试。
- 主板必须包括其他行业标准组件和/或板外接口（例如，标准硬件测试设备）以验证 IP 内核管理的协议。内核测试中必须至少采用了典型的配置和参数以及典型的性能指标。
- 硬件平台说明
- 核心文档必须包含对所用硬件平台的说明，包括所用组件的类型。
- 互操作性测试过程文档
- 核心文档必须包含对所执行的测试的描述。也可酌情提供有关测试结果的详细信息。
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