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1. DisplayPort Intel FPGA IP设计示例快速入门指南
| 所作的更新针对于: |
|---|
| Intel® Quartus® Prime设计套件 21.4 |
| IP版本 21.0.0 |
| 本翻译版本仅供参考，如果本翻译版本与其英文版本存在差异，则以英文版本为准。某些翻译版本尚未更新对应到最新的英文版本，请参考英文版本以获取最新信息。 |
Intel® Agilex™ F-tile器件的DisplayPort Intel® FPGA IP设计示例的特性包括一个仿真测试台和一个支持编译和硬件测试的硬件设计。
DisplayPort Intel® FPGA IP提供以下设计示例：
- 没有静态速率上Pixel Clock Recovery (PCR)模块的DisplayPort SST并行环回
当生成一个设计示例时，参数编辑器自动创建在硬件中仿真，编译和测试设计所需要的文件。
注： Intel® Quartus® Prime 21.4软件版本仅支持用于仿真，综合，编译和时序分析目的的初步设计示例。硬件功能尚未完全验证。
图 1. 开发阶段