文章 ID: 000093638 内容类型: 错误讯息 上次审核日期: 2024 年 05 月 06 日

当数据速率介于 16.3 Gbps 和 17.1 Gbps 之间时,为什么 F-Tile JESD204C Agilex™ 7 FPGA IP 设计示例生成会失败?

环境

  • 英特尔® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    说明

    由于 Quartus® Prime Pro Edition 软件版本 22.4 存在一个问题,当所有 PMA 速度等级设备的数据速率介于 16.3 Gbps 和 17.1 Gbps 之间时,您可能会看到 F-Tile JESD204C Agilex™ 7 FPGA IP 设计示例生成故障。

    此问题的原因是内部锁相环 (PLL) 被选择为错误的模式。

    解决方法

    没有解决方法。

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    本文适用于 1 产品

    英特尔® Agilex™ FPGA 和 SoC FPGA

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