文章 ID: 000087348 内容类型: 错误讯息 上次审核日期: 2021 年 09 月 02 日

错误 (18496):输出太靠近 PLL 时钟输入引脚

环境

  • 英特尔® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    说明

    在编译针对MAX® 10 设备的设计时,您可能会看到此错误消息,该设备在 Quartus® Prime 软件版本 16.1 中没有引脚分配。

     

    解决方法

    要解决此问题,在分配编辑器中手动将受影响引脚的位置从 PLL 时钟输入引脚下分配。

    Quartus Prime 17.0 版解决了此问题。

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    本文适用于 1 产品

    英特尔® MAX® 10 FPGA

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