以下是用于实施 VSEC 寄存器使用的框架。
1) 使用内部 RAM 在FPGA结构中设置您的 VSEC 内存。
2) 在 Altera® 特定供应商 (VSEC) 扩展功能接头 (偏移0x200),设置位 [31:20]至0x400(为 HardIP 保留空间,其他保留位置也可用)
3) 解码针对范围0x400的 TRP,以及() 全新 VSEC 功能所需的内存大小
4) 确保通过应用层逻辑解码和编码 VSEC 内存
以下是用于实施 VSEC 寄存器使用的框架。
1) 使用内部 RAM 在FPGA结构中设置您的 VSEC 内存。
2) 在 Altera® 特定供应商 (VSEC) 扩展功能接头 (偏移0x200),设置位 [31:20]至0x400(为 HardIP 保留空间,其他保留位置也可用)
3) 解码针对范围0x400的 TRP,以及() 全新 VSEC 功能所需的内存大小
4) 确保通过应用层逻辑解码和编码 VSEC 内存
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